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PALASM portieren auf VHDL


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Hat jemand von euch schon Erfahrung mit der Programmierung von CPLD oder Logik-Bausteinen generell?

Ich habe hier ein Design in PALASM für einen AMD PALCE20V8 und möchte das ganze in VHDL portieren um einen Xilinx XC9500 CPLD Baustein zu programmieren. Vielleicht hat einer von euch schon Erfahrung mit Tools oder Docu's. Jede Info ist willkommen ;)

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